VHDL描述組合邏輯電路

發(fā)布時(shí)間:2024-03-07
邏輯電路由于只分高、低電平,抗干擾力強(qiáng),精度和保密性佳。廣泛應(yīng)用于計(jì)算機(jī)、數(shù)字控制、通信、自動(dòng)化和儀表等方面。 最基本的有與電路或電路和非電路。還有異或門(mén),與非門(mén)。
“邏輯電路”在漢英詞典中的解釋(a logical circuit 簡(jiǎn)單的邏輯電路通常是由門(mén)電路構(gòu)成,也可以用三極管來(lái)制作,例如,一個(gè)npn三極管的集電極和另一個(gè)npn三極管的發(fā)射極連接,這就可以看作是一個(gè)簡(jiǎn)單的與門(mén)電路,即:當(dāng)兩個(gè)三極管的基極都接高電平的時(shí)候,電路導(dǎo)通,而只要有一個(gè)不接高電平,電路就不導(dǎo)通…… 邏輯電路分為3類(lèi):非門(mén),與門(mén),或門(mén)。 非門(mén):利用內(nèi)部結(jié)構(gòu),使輸入的電勢(shì)變成相反的電勢(shì),高電勢(shì)變低電勢(shì),低電勢(shì)變高電勢(shì)。與門(mén):又稱(chēng)“與電路”。執(zhí)行“與”運(yùn)算的基本門(mén)電路。有幾個(gè)輸入端,只有一個(gè)輸出端。當(dāng)所有的輸入同時(shí)為“1”電平時(shí),輸出才為“1”電高,否則輸出為“0”電平。與的含義是∶只有當(dāng)決定一件事的所有條件都具備時(shí),這個(gè)事件才會(huì)發(fā)生。邏輯與也稱(chēng)邏輯乘。又稱(chēng)“或電路”。執(zhí)行“或”運(yùn)算的基本門(mén)電路。有幾個(gè)輸入端,只有一個(gè)輸出端。只要輸入中有一個(gè)為“1”電平時(shí),輸出就為“1”電平,只有當(dāng)所有的輸入全為“0”電平時(shí),輸出才為“0”電平。
非門(mén)的電路狀態(tài)表:
a f
1 0
0 1
與門(mén)的電路狀態(tài)表:
a b z
0 0 0
0 1 0
1 0 0
1 1 1
或門(mén)的電路狀態(tài)表:
a b f
0 0 0
0 1 1
1 0 1
1 1 1
上一個(gè):直流電機(jī)的IR2110驅(qū)動(dòng)控制設(shè)計(jì)及DSP實(shí)現(xiàn)
下一個(gè):離婚協(xié)議簽訂以后是否能推翻

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